Electrónica

2. El bit del eje X - Y se mantiene a nivel alto hasta que se completa el tiempo de descarga.

El valor de R es lineal. Posibles utilidades del puerto de JoyStick (Aparte, l�gicamente, de la habitual) � Como puerto de cuatro entradas digitales, formado por los cuatro botones de disparo, por ejemplo en una central de alarma. � Como puerto de cuatro entradas anal�gicas, formado por los ejes X - Y de ambos JoyStick, por ejemplo para colocar unas resistencias sensibles a la temperatura (PTC o NTC) y fabricarnos un term�metro, o para colocar una fotorresistencia, para hacernos un sensor lum�nico o un fot�metro. Todo queda en poder de la imaginaci�n del dise�ador.

PIN-9	PIN-25	DESCRIPCION
1	8	Carrier Detect (DCD/CD); Detecci�n de portadora.
2	3	Receive Data (RXD/RD); Entrada de datos.
3	2	Transmit Data (TXD/TD); Salida de datos.
4	20	Data Terminal Ready (DTR); Indica que el puerto est� preparado.
5	7	Signal Ground (GND/SG); Proporciona la referencia cero de voltaje.
6	6	Data Set Ready (DSR); Datos preparados, listo para recibir.
7	4	Request to Send (RTS); Petici�n de envio de datos.
8	5	Clear to Send (CTS); Indica que se desea transmitir.
9	22	Ring Indicator (RI); Anuncia una llamada al otro dispositivo.
-	9-19	No empleadas
-	1	Masa del chasis (GND)

Voltajes m�ximos entre -15V y +15V.

Salidas binarias entre +5V a +15V y -5V a -15V.

Entradas binarias entre +3V a +15V y -3V a -15V.

Voltajes de entrada entre -3V a +3V y voltajes de salida entre -5V a +5V son indefinidos. Voltajes positivos indican ON o ESPACIO, voltajes negativos indican OFF o MARCA. BUS ISA de 8/16 bits

El BUS cl�sico de un PC (ISA BUS) se compone de dos partes: La cl�sica de 8 bits, perteneciente a los PC, XT y AT. La extensi�n de 16 bits de los AT.

Entre ambos forman el bus ISA que todos los ordenadores PC actuales poseen (no confundir con VESA o PCI, siendo el primero una tercera ampliaci�n del bus ISA de 8 bits y el PCI un bus totalmente diferente).

Estructura del BUS de 8 bits PC, XT y AT:

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Tierra -|B1 A1|- -I/O CH CHK (NMI)

+Reset DRV -|B2 A2|- +D7

+5V -|B3 A3|- +D6

+IRQ2 -|B4 A4|- +D5

-5V -|B5 A5|- +D4

+DRQ2 -|B6 A6|- +D3

-12V -|B7 A7|- +D2

-CARD SLCTD -|B8 A8|- +D1

+12V -|B9 A9|- +D0

Tierra -|B10 A10|- +I/O CH RDY

-MEMW -|B11 A11|- +AEN

-MEMR -|B12 A12|- +A19

-IOW -|B13 A13|- +A18

-IOR -|B14 A14|- +A17

-DACK3 -|B15 A15|- +A16

+DRQ3 -|B16 A16|- +A15

-DACK1 -|B17 A17|- +A14

+DRQ1 -|B18 A18|- +A13

-DACK0 (MREF) -|B19 A19|- +A12

CLK -|B20 A20|- +A11

+IRQ7 -|B21 A21|- +A10

+IRQ6 -|B22 A22|- +A9

+IRQ5 -|B23 A23|- +A8

+IRQ4 -|B24 A24|- +A7

+IRQ3 -|B25 A25|- +A6

-DACK2 -|B26 A26|- +A5

+TC -|B27 A27|- +A4

+ALE -|B28 A28|- +A3

+5V -|B29 A29|- +A2

+OSC -|B30 A30|- +A1

Tierra -|B31 A31|- +A0

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Extension AT de 16 Bit:

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-MEM CS16 -|D1 C1|- SBHE

-I/O CS16 -|D2 C2|- A23

IRQ10 -|D3 C3|- A22

IRQ11 -|D4 C4|- A21

IRQ12 -|D5 C2|- A20

IRQ15 -|D6 C6|- A19

IRQ14 -|D7 C7|- A18

-DACK0 -|D8 C8|- A17

DRQ0 -|D9 C9|- -MEMR

-DACK5 -|D10 C10|- -MEMW

DRQ5 -|D11 C11|- D8

-DACK6 -|D12 C12|- D9

DRQ6 -|D13 C13|- D10

-DACK7 -|D14 C24|- D11

DRQ7 -|D15 C15|- D12

+5V -|D16 C16|- D13

-Master -|D17 C17|- D14

Tierra -|D18 C18|- D15

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La numeraci�n empieza desde la parte posterior de la m�quina.

SE�AL	DESCRIPCION
A0-A19	Bits de direcci�n 0-19, permiten direccionar 1Mb de memoria y 64K de puertos de e/s.
A17-A23	Bits de direcci�n 17-23, permiten direccionar desde 256Kb de memoria a 16Mb.
AEN	Address Enable; Cuando est� activa el controlador DMA posee el control de las l�neas de direcci�n y del BUS de datos, conforme se indique en MEMR/MEMW. Cuando est� inactiva la CPU tiene el control de estas l�neas.
ALE	Address Latch Enable (salida); se emplea para que la CPU est� aislada de las lineas de direcci�n (triestado). Es forzado activado durante los ciclos DMA.
CARD SLCTD	Card Selected; indica que una tarjeta ha sido activada en el slot XT de 8 bits.
CLK	Se�al de reloj del sistema (actual velocidad del BUS).
D0-D7	Bits de datos 0-7 para e/s a memoria o puertos de e/s.
DACK0-DACK3	Reconocimiento DMA para los canales 0 al 3; empleada por el controlador para reconocer una petici�n DMA (validaci�n de acceso DMA). DACK0 es empleada para el refresco de memoria (MREF).
DRQ0-DRQ3	Petici�n DMA 0-3; empleada por perif�ricos que desean los servicios del controlador DMA; Se mantiene activa hasta que la correspondiente se�al DACKx se hace activa.
I/O CH CHK	I/O Channel Check; Genera una interrupci�n no enmascarable.
I/O CH RDY	I/O Channel Ready; es puesta inactiva por memoria o dispositivos de e/s para retardar el acceso a memoria o los ciclos de e/s. Normalmente es empleada por dispositivos lentos para a�adir estados de espera. No debe ser inactiva durante m�s de 17 ciclos.
I/O CS16	I/O Chip Select 16 Bit; indica ciclo de e/s de 16 bits
IOR	I/O Read; indica a un dispositivo de e/s que coloque su dato en el BUS del sistema.
IOW	I/O Write; indica a un dispositivo de e/s a leer un dato del BUS del sistema.
IRQ2-IRQ7	Petici�n de interrupci�n 2-7; indica a la CPU que un dispositivo de e/s necesita servicio.
MASTER	Empleado por DRQ para ganar el control del sistema.
MEM CS16	Memory Chip Select 16 bit; indica ciclo de memoria de 16 bits.
MEMR	Memory Read; esta se�al es producida por la CPU o el controlador DMA e indica a la memoria que debe introducir el dato direccionado en el BUS del sistema. Presente tanto en el BUS PC como en la extensi�n AT.
MEMW	Memory Write; esta se�al es producida por la CPU o el controlador DMA e indica a la memoria que debe leer y almacenar el dato presente en el BUS. Presente tanto en el BUS PC como en la extensi�n AT.
OSC	Oscilador; Se�al de reloj de 14.31818 MHZ (periodo de 70ns); 50% del ciclo de servicio.
RESET DRV	Reset Drive; empleada para restablecer la l�gica del sistema.
SBHE	System BUS High Enable; activa los bits de datos 8-15 de la extensi�n AT del BUS.
TC	Terminal Count; produce un impulso cuando la cuenta final de un canal DMA es alcanzado.

Todas las se�ales del BUS ISA emplean niveles TTL estandard. La entrada y la salida es con respecto a la CPU. E/S significa entrada/salida.

Cables y Conectores

El conjunto cable-conector empleado viene dado principalmente de el tipo de se�al a transmitir a trav�s de el. Principalmente para manejar palabras de 8 bits, empleamos cable de list�n con conectores de m�s de 9 terminales. Estos conectores se emplean m�s com�nmente en el puerto serie y paralelo de la PC. A continuaci�n se presentan sus configuraciones empleadas.

Conector Paralelo PC 25

En la PC

25 Pin Sub-D Hembra en la PC.

Pin	Name	Dir	Description
1	/STROBE		Strobe
2	D0		Data Bit 0
3	D1		Data Bit 1
4	D2		Data Bit 2
5	D3		Data Bit 3
6	D4		Data Bit 4
7	D5		Data Bit 5
8	D6		Data Bit 6
9	D7		Data Bit 7
10	/ACK		Acknowledge
11	BUSY		Busy
12	PE		Paper End
13	SEL		Select
14	/AUTOFD		Autofeed
15	/ERROR		Error
16	/INIT		Initialize
17	/SELIN		Select In
18	GND		Signal Ground
19	GND		Signal Ground
20	GND		Signal Ground
21	GND		Signal Ground
22	GND		Signal Ground
23	GND		Signal Ground
24	GND		Signal Ground
25	GND		Signal Ground

Conector JoySctick

En la PC En el cable

15 Pin Sub-D Hembra en la computadora.

15 Pin Sub-D Macho en el cable del joystick.

Pin	Name	Dir	Description
1	+5V		+5 VDC
2	/B1		Button 1
3	X1		Joystick 1 - X
4	GND		Ground
5	GND		Ground
6	Y1		Joystick 1 - Y
7	/B2		Button 2
8	+5V		+5 VDC
9	+5V		+5 VDC
10	/B4		Button 4
11	X2		Joystick 2 - X
12	MIDITXD		MIDI Transmit
13	Y2		Joystick 2 - Y
14	/B3		Button 3
15	MIDIRXD		MIDI Receive